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France - Design and execution in research and development - Layout services for analogue and mixed-signal integrated circuits

Original France - Conception et exécution dans le domaine de la recherche et du développement - Prestations de layout de circuits intégrés analogiques et mixtes

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Summary

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The buyer is CEA Grenoble. The contract covers layout services for analogue and mixed-signal integrated circuit blocks. The contractor works from annotated schematics in a Cadence database, performing block layout (schematic analysis, floorplan proposal, component placement and routing, DRC and LVS checks), assembly of blocks into macro-blocks, and TOP-level assembly for analogue circuit tops. Extracted views with parasitic elements are simulated by CEA designers to validate performance, with layout optimisation possible if results are insufficient. The contract was awarded to SEGULA ENGINEERING, ATOS FRANCE and ADENTIS SA.

Description

Les prestations confiées au titulaire seront des prestations de layouts de blocs analogiques et mixtes. Ces blocs seront décrits sous forme de schémas annotés disponibles dans une base de données Cadence au démarrage de la tâche. Une base de données de circuit intégré rassemble notamment tous schémas constituant le circuit, organisés de façon hiérarchique. L’implémentation physique de ces schémas va se faire en plusieurs étapes et selon plusieurs granularités. On peut les décrire ainsi : Layout d’un schéma de bloc : - Analyse du schéma : o Identification des points sensibles, des contraintes topologiques, des précautions d’implémentation à prendre o Proposition d’un floorplan du bloc et évaluation de la surface - Réalisation du layout : o Placement et connexion des composants o Proposition de modification mineure schéma si pertinent - Réalisation des vérifications : o DRC o LVS A l’issue des étapes de layout, des vues schémas intégrant les éléments parasites induits par l’implémentation physique sont extraites et simulées par les concepteurs CEA pour valider l’adéquation du layout avec la performance attendue. En cas de performances insuffisantes, une reprise pour optimisation du layout peut être demandée. Layout d’assemblage de blocs entre eux en macro-blocs : les étapes sont sensiblement les même que pour les blocs unitaires, (analyse, layout, vérifications), mais à un niveau de hiérarchie supérieur. La complexité de ces assemblages dépend du nombre des signaux d’interface, des contraintes topologiques diverses (contraintes d’alimentations, d’isolation, de limites de surfaces…) Layout d’assemblage TOP : Il s’agit de faire l’assemblage aux plus hauts niveaux du circuit, entre les plots (souvent organisés en couronne), et les macro-blocs de plus haut niveau. Cet assemblage est très différent si le TOP du circuit est dit « numérique » ou « analogique ». Les assemblages TOP considérés pour les tâches de layout seront uniquement des TOP analogiques.

Official source

Source: TED - Tenders Electronic Daily (Publications Office of the EU)

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Last verified against TED - Tenders Electronic Daily (Publications Office of the EU) 7 hours ago

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