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France - Conception et exécution dans le domaine de la recherche et du développement - Prestations de layout de circuits intégrés analogiques et mixtes

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L'acheteur est le CEA Grenoble. Le contrat porte sur des prestations de layout de blocs analogiques et mixtes de circuits intégrés. Le titulaire travaille à partir de schémas annotés dans une base de données Cadence et réalise le layout de blocs (analyse des schémas, proposition de floorplan, placement et connexion des composants, vérifications DRC et LVS), l'assemblage de blocs en macro-blocs et l'assemblage TOP de circuits analogiques. Les vues extraites avec éléments parasites sont simulées par les concepteurs du CEA pour valider les performances; une optimisation du layout peut être demandée si elles sont insuffisantes. Le contrat a été attribué à SEGULA ENGINEERING, ATOS FRANCE et ADENTIS SA.

Description

Les prestations confiées au titulaire seront des prestations de layouts de blocs analogiques et mixtes. Ces blocs seront décrits sous forme de schémas annotés disponibles dans une base de données Cadence au démarrage de la tâche. Une base de données de circuit intégré rassemble notamment tous schémas constituant le circuit, organisés de façon hiérarchique. L’implémentation physique de ces schémas va se faire en plusieurs étapes et selon plusieurs granularités. On peut les décrire ainsi : Layout d’un schéma de bloc : - Analyse du schéma : o Identification des points sensibles, des contraintes topologiques, des précautions d’implémentation à prendre o Proposition d’un floorplan du bloc et évaluation de la surface - Réalisation du layout : o Placement et connexion des composants o Proposition de modification mineure schéma si pertinent - Réalisation des vérifications : o DRC o LVS A l’issue des étapes de layout, des vues schémas intégrant les éléments parasites induits par l’implémentation physique sont extraites et simulées par les concepteurs CEA pour valider l’adéquation du layout avec la performance attendue. En cas de performances insuffisantes, une reprise pour optimisation du layout peut être demandée. Layout d’assemblage de blocs entre eux en macro-blocs : les étapes sont sensiblement les même que pour les blocs unitaires, (analyse, layout, vérifications), mais à un niveau de hiérarchie supérieur. La complexité de ces assemblages dépend du nombre des signaux d’interface, des contraintes topologiques diverses (contraintes d’alimentations, d’isolation, de limites de surfaces…) Layout d’assemblage TOP : Il s’agit de faire l’assemblage aux plus hauts niveaux du circuit, entre les plots (souvent organisés en couronne), et les macro-blocs de plus haut niveau. Cet assemblage est très différent si le TOP du circuit est dit « numérique » ou « analogique ». Les assemblages TOP considérés pour les tâches de layout seront uniquement des TOP analogiques.

Source officielle

Source : TED - Tenders Electronic Daily (Publications Office of the EU)

Vérifiez toujours les détails dans l'avis officiel.

Dernière vérification auprès de TED - Tenders Electronic Daily (Publications Office of the EU) il y a 3 heures

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